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Neuartiges Design zur Optimierung von Leistung und Fläche in sequentiellen Schaltungen

by Rekha S , Nataraj K. R.
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Book cover type: Paperback
  • ISBN13: 9786209664830
  • Binding: Paperback
  • Subject: N/A
  • Publisher: Verlag Unser Wissen
  • Publisher Imprint: Verlag Unser Wissen
  • Publication Date:
  • Pages: 104
  • Original Price: USD 77.0
  • Language: German
  • Edition: N/A
  • Item Weight: 150 grams
  • BISAC Subject(s): Electronics / General

Aufgrund der geringen Verlustleistung, der einfachen Implementierung und der hohen Effizienz hat sich die komplement�re Metalloxid-Halbleiter-Logik (CMOS) zur bevorzugten Technologie f�r das digitale VLSI-Design entwickelt. Im Gegensatz zu fr�heren Logikfamilien, die unter kontinuierlichen Vorspannungsstr�men und Leckageproblemen litten, bot CMOS eine wesentliche Verbesserung. Mit der Skalierung von VLSI haben Merkmale wie h�here Geschwindigkeit, geringerer Stromverbrauch, bessere Zuverl�ssigkeit und geringere Fl�che zu gro en Ver�nderungen bei den Herstellungstrends gef�hrt. Das Aufkommen von Logikformen wie Pseudo-NMOS, DCVSL, PTL und DPTL hat die Branche weiter ver�ndert. Da die Anforderungen an die Leistung stiegen, wurden Geschwindigkeit und Fl�che zu dominierenden Designeinschr�nkungen, was zur Entwicklung von dynamischen und Domino-Logikfamilien f�hrte. In jeder digitalen Schaltung sind die wichtigsten Designfaktoren Leistung, Geschwindigkeit, Fl�che, Rauschfestigkeit und Kosten, die oft sorgf�ltige Kompromisse erfordern. W�hrend die Domino-Logik aufgrund ihrer hohen Geschwindigkeit und kompakten Fl�che weit verbreitet ist, leidet sie unter ihrem hohen Stromverbrauch und ihrer Rauschempfindlichkeit. Um diese Einschr�nkungen zu �berwinden, sind verbesserte Entwurfstechniken erforderlich.

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