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Conception d'un multiplicateur védique basse consommation tenant compte des variations PVT pour les DSP sur FPGA

by Kavita Goswami , Bishwajeet Pandey
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Book cover type: Paperback
  • ISBN13: 9786209931178
  • Binding: Paperback
  • Subject: N/A
  • Publisher: Editions Notre Savoir
  • Publisher Imprint: Editions Notre Savoir
  • Publication Date:
  • Pages: 104
  • Original Price: GBP 58.0
  • Language: French
  • Edition: N/A
  • Item Weight: 150 grams
  • BISAC Subject(s): General

� mesure que les secteurs des communications et du traitement du signal se d�veloppent, la demande en multiplicateurs ne cesse d'augmenter � un rythme effr�n�. Pour les chercheurs, le d�veloppement de multiplicateurs � haute vitesse et � faible consommation d'�nergie constitue un enjeu majeur. La r�duction de la consommation d'�nergie et du temps de propagation d'un circuit multiplicateur devrait r�volutionner le domaine de l'�lectronique et des communications. Les performances d'un syst�me sont g�n�ralement d�termin�es par celles du multiplicateur, car ce dernier est g�n�ralement l'�l�ment le plus lent du syst�me. Par cons�quent, l'optimisation de la vitesse et de la consommation d'�nergie du multiplicateur constitue un enjeu majeur de conception. Il est n�cessaire de d�velopper des multiplicateurs � haute vitesse et � faible consommation d'�nergie pour les algorithmes de traitement des signaux num�riques. Des recherches ant�rieures ont conclu que les multiplicateurs v�diques sont plus efficaces que les multiplicateurs conventionnels. Dans ce travail, un multiplicateur v�dique � faible consommation d'�nergie a �t� propos�.

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