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Processore RISC dual core con hardware configurabile tramite VERILOG

by Nishant Kumar , Ekta Aggrawal
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Book cover type: Paperback
  • ISBN13: 9786209233258
  • Binding: Paperback
  • Subject: N/A
  • Publisher: Edizioni Sapienza
  • Publisher Imprint: Edizioni Sapienza
  • Publication Date:
  • Pages: 68
  • Original Price: GBP 34.0
  • Language: Italian
  • Edition: N/A
  • Item Weight: 105 grams
  • BISAC Subject(s): Careers / General

Questo libro propone la progettazione e l'architettura di un processore dual-core in pipeline dinamicamente scalabile. La metodologia di progettazione consiste nella fusione dei due processori, in cui due core indipendenti possono trasformarsi dinamicamente in un'unit� di elaborazione pi� grande, oppure possono essere utilizzati come elementi di elaborazione distinti per ottenere elevate prestazioni sequenziali e parallele. Il processore offre due modalit� di esecuzione. La modalit� 1 � una modalit� multiprogrammazione per l'esecuzione di flussi di istruzioni con larghezza di dati inferiore, ovvero ogni core pu� eseguire operazioni a 16 bit individualmente. In questa modalit� le prestazioni sono migliorate grazie all'esecuzione parallela delle istruzioni in entrambi i core, a scapito dell'area. Nella modalit� 2, entrambi i core di elaborazione sono accoppiati e si comportano come un'unica unit� di elaborazione con larghezza di dati elevata, ovvero possono eseguire operazioni a 32 bit. Per realizzare questa modalit� � necessaria una comunicazione aggiuntiva tra i core. La modalit� pu� cambiare dinamicamente; pertanto, questo processore pu� fornire multifunzionalit� con un unico design. La progettazione e la verifica del processore sono state eseguite con successo utilizzando Verilog sulla piattaforma Xilinx 14.1. Il processore � stato verificato sia in simulazione che in sintesi con l'aiuto di programmi di test.

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